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用于逻辑综合的VHDL 简介
本书侧重于介绍面向逻辑综合的VHDL程序的编写方法, 全面介绍了可综合的VHDL语法条款。但是, 考虑到测试工作的重要性, 《国外数字系统设计经典教材系列: 用于逻辑综合的VHDL( 第3版) 》也介绍了一部分最为实用的与编写测试平台有关的VHDL语法。并列题名： VHDL for logic synthesis eng
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